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(完整EDA课程设计——数字抢答器
数字式竞赛抢答器
设计要求
1、设计一个可容纳4组参赛的数字式抢答器，每组设一个按钮,供抢答使用.2、抢答器具有第一信号鉴别和锁存功能，使除第一抢答者外的按钮不起作用。3、设置一个主持人“复位”按钮。

4、主持人复位后，开始抢答，第一信号鉴别锁存电路得到信号后，有指示灯显示抢答组别,扬声器发出2～3秒的音响。

5、设置一个计分电路,每组开始预置100分,由主持人记分,答对一次加10分，答错一次减10分。

1、总体方案设计原理及分析
1.1、方案原理
按照设计要求，设计一个4组参赛的抢答器,所以这种抢答器要求有四路不同组别的抢答输入信号，并能识别最先抢答的信号，直观地通过数码显示和蜂鸣报警等方式提示主持人并显示出组别；同时该系统还应有复位功能。主持人按下系统复位键（RST，系统进入抢答状态，计分模块输出初始信号给数码显示模块并显示出初始值。当某参赛组抢先将抢答键按下时，系统将其余三路抢答信号封锁，同时扬声器发出2-3秒的声音提示，组别显示模块送出信号给数码显示模块,从而显示出该抢答成功组台号，并一直保持到下一轮主持人将系统清零为止。主持人对抢答结果进行确认，随后，计时模块送出倒计时计数允许信号，开始回答问题，计时显示器则从初始值开始以计时，在规定的时间内根据答题的正误来确定加分或减分，并通过数码显示模块将成绩显示出来。计时至0时，停止计时，扬声器发出超时报警信号，以中止未回答完问题。当主持人给出倒计时停止信号时，扬声器停止鸣叫.若参赛者在规定时间内回答完为题，主
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持人可给出倒计时计数停止信号,以免扬声器鸣叫。主持人按下复位键,即RST为高电平有效状态，清除前一次的抢答组别，又可开始新的一轮的抢答。
此抢答器的设计中采用自顶向下的设计思路,运用VHDL硬件描述语言对各个模块进行层次化、系统化的描述,并且先设计一个顶层文件，再把各个模块连接起来。
1。2、方案设计框图

主持人控制开关抢答按钮
预制
控制电路优先编码
计分电路
报警电路锁存器
译码电路
译码电路
显示电路
显示电路

主电路扩展功能电路

图1方案系统结构图
1.3、方案各路功能分析
此方案是由主体电路和扩展电路两部分构成，整个系统包括这样几个主要模块：抢答鉴别模块、抢答计时模块、抢答计分模块、译码显示模块、报警模块。
主体电路完成基本的抢答功能,接通电源时，主持人将开关置于“清除”位置,抢答器处于禁止工作状态，编号显示器灭灯；抢答开始时,主持人将控制开关拨到“开始”位置,扬声器给
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